Tsmc spricht über seinen Herstellungsprozess bei 5nm Finfet
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Der neue 7-nm-FinFET-Fertigungsprozess (CLN7FF) von TSMC ist in die Massenproduktionsphase eingetreten. Daher plant Smelting bereits seine 5-nm- Prozess- Roadmap, die hoffentlich irgendwann im Jahr 2020 fertig sein wird.
TSMC spricht über Verbesserungen seines 5-nm-Prozesses, der auf EUV-Technologie basieren wird
5 nm wird das zweite TSMC-Herstellungsverfahren sein, bei dem die Extreme UltraViolet (EUV) -Lithographie verwendet wird, mit der eine enorme Erhöhung der Transistordichte mit einer Flächenreduzierung von 70% im Vergleich zu 16 nm erzielt werden kann. Der erste Knoten des Unternehmens, der EUV-Technologie einsetzt, wird der 7nm + (CLN7FF +) sein, obwohl EUV bei seiner ersten Implementierung sparsam eingesetzt wird, um die Komplexität zu reduzieren.
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Dies wird als Lernphase für die Verwendung von EUV hauptsächlich im zukünftigen 5-nm-Prozess dienen, der eine Reduzierung des Stromverbrauchs um 20% bei gleicher Leistung oder einen Leistungsgewinn von 15% bietet bei gleichem Energieverbrauch im Vergleich zu 7nm. Wenn mit 5 nm große Verbesserungen erzielt werden, wird die Fläche um 45% reduziert, wodurch 80% mehr Transistoren in derselben Flächeneinheit platziert werden können als mit 7 nm, wodurch extrem komplexe Chips mit Größen erzeugt werden können viel kleiner.
TSMC möchte Architekten auch dabei helfen, höhere Taktraten zu erreichen. Zu diesem Zweck wurde angegeben, dass ein neuer ELTV-Modus (Extrem Extrem Low Threshold Voltage) eine Erhöhung der Chipfrequenzen um bis zu 25% ermöglicht, obwohl der Hersteller Es wurde nicht sehr detailliert auf diese Technologie eingegangen oder auf welche Art von Chips sie angewendet werden kann.
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