Hersteller planen bereits 3D-Fertigung 120/128 Schicht nand
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Die Chiphersteller haben die Entwicklung ihrer jeweiligen 3D-NAND- Technologien mit 120 und 128 Schichten verstärkt, um die Wettbewerbsfähigkeit der Kosten zu steigern, und bereiten sich auf diesen Sprung bis 2020 vor.
Die 120- und 128-Schicht-3D-NAND-Module sind bereits in Bearbeitung
Einige der führenden NAND-Chiphersteller haben im ersten Halbjahr 2020 Muster ihrer 128- Schicht- Chips für die Serienproduktion geliefert. Kontinuierliche Preissenkungen bei der NAND-Flash-Technologie sowie zunehmende Unsicherheit auf der Nachfrageseite haben die Hersteller veranlasst, ihren technologischen Fortschritt aus Kostengründen zu beschleunigen.
SK Hynix begann im März mit dem Testen seines 96-Lagen-4D-NAND-Blitzes. Toshiba und Western Digital hatten bereits Pläne, die 128-Lagen-Technologie einzuführen, die auf der Triple Level Cell (TLC) -Prozess-Technologie basiert, um die Dichte zu erhöhen und diese zu vermeiden Zeitleistungsprobleme bei aktuellen QLC-Implementierungen (Quad Level Cell).
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Der Rückgang der Marktpreise für die NAND-Flash-Technologie führt bei Chipherstellern zu Rentabilitätsproblemen. Der Branchenführer Samsung Electronics ist keine Ausnahme, da das NAND-Flash-Technologie-Geschäft des Anbieters einen enormen Gewinnrückgang verzeichnete und fast die Gewinnschwelle erreichte.
Samsung und andere große Chiphersteller haben seit Ende 2018 begonnen, die Produktion zu reduzieren, um die Preise für die NAND-Flash-Technologie zu stabilisieren. Die Bemühungen haben jedoch kaum funktioniert, da der 64-Lagen-3D-NAND-Prozess bereits eine Technologie ist. reift und es gibt einen großen Überbestand davon, sagten Quellen.
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